參數(shù)資料
型號: MPC5200B
廠商: 飛思卡爾半導(dǎo)體(中國)有限公司
英文描述: SDRAM/DDR Memory Controller
中文描述: 內(nèi)存/ DDR存儲器控制器
文件頁數(shù): 58/78頁
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代理商: MPC5200B
MPC5200B Data Sheet, Rev. 1
Electrical and Thermal Characteristics
Freescale Semiconductor
58
3.3.16 GPIOs and Timers
3.3.16.1 General and Asynchronous Signals
The MPC5200B contains several sets if I/Os that do not require special setup, hold, or valid requirements.
Most of these are asynchronous to the system clock. The following numbers are provided for test and
validation purposes only, and they assume a 133 MHz internal bus frequency.
Figure 45
shows the GPIO Timing Diagram.
Table 50
gives the timing specifications.
Figure 45. Timing Diagram—Asynchronous Signals
Table 50. Asynchronous Signals
Sym
Description
Min
Max
Units
SpecID
t
CK
Clock Period
7.52
ns
A16.1
t
IS
Input Setup
12
ns
A16.2
t
IH
Input Hold
1
ns
A16.3
t
DV
Output Valid
15.33
ns
A16.4
t
DH
Output Hold
1
ns
A16.5
Output
Input
t
CK
valid
valid
t
DV
t
DH
t
IS
t
IH
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