參數(shù)資料
型號： MPC5200B
廠商： 飛思卡爾半導(dǎo)體(中國)有限公司
英文描述： SDRAM/DDR Memory Controller
中文描述： 內(nèi)存/ DDR存儲器控制器
文件頁數(shù)： 52/78頁
文件大?。?/td> 629K
代理商： MPC5200B
MPC5200B Data Sheet, Rev. 1
Electrical and Thermal Characteristics
Freescale Semiconductor
52
Figure 38. Timing Diagram — 8,16, 24, and 32-bit CODEC / I
2
S Slave Mode
3.3.15.2 AC97 Mode
NOTE
Output timing is specified at a nominal 50 pF load.
Table 44. Timing Specifications — AC97 Mode
Sym
Description
Min
Typ
Max
Units
SpecID
1
Bit Clock cycle time
—
81.4
—
ns
A15.15
2
Clock pulse high time
—
40.7
—
ns
A15.16
3
Clock pulse low time
—
40.7
—
ns
A15.17
4
FrameSync valid after rising clock edge
—
—
13.0
ns
A15.18
5
Output Data valid after rising clock edge
—
—
14.0
ns
A15.19
6
Input Data setup time
1.0
—
—
ns
A15.20
7
Input Data hold time
1.0
—
—
ns
A15.21
BitClk
3
(CLKPOL=0)
BitClk
(CLKPOL=1)
FrameSync
(SyncPol = 1)
TxD
Output
Input
Input
4
5
Input
FrameSync
(SyncPol = 0)
Input
RxD
Input
1
2
2
6
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PDF描述
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