參數(shù)資料
型號： MPC5200B
廠商： 飛思卡爾半導(dǎo)體(中國)有限公司
英文描述： SDRAM/DDR Memory Controller
中文描述： 內(nèi)存/ DDR存儲器控制器
文件頁數(shù)： 41/78頁
文件大?。?/td> 629K
代理商： MPC5200B
Electrical and Thermal Characteristics
MPC5200B Data Sheet, Rev. 1
Freescale Semiconductor
41
Figure 26. Timing Diagram-ATA-ISOLATION
3.3.9
Ethernet
AC Test Timing Conditions:
Output Loading
All Outputs: 25 pF
Table 30. Timing Specification ata_isolation
Sym
Description
Min
Max
Units
SpecID
1
ata_isolation setup time
7
-
IP Bus cycles
A8.48
2
ata_isolation hold time
-
19
IP Bus cycles
A8.49
Table 31. MII Rx Signal Timing
Sym
Description
Min
Max
Unit
SpecID
t
1
RXD[3:0], RX_DV, RX_ER to RX_CLK setup
10
—
ns
A9.1
t
2
RX_CLK to RXD[3:0], RX_DV, RX_ER hold
10
—
ns
A9.2
t
3
RX_CLK pulse width high
35%
65%
RX_CLK Period
(1)
NOTES:
1
RX_CLK shall have a frequency of 25% of data rate of the received signal. See the IEEE 802.3 Specification [6].
A9.3
t
4
RX_CLK pulse width low
35%
65%
RX_CLK Period
(
1)
A9.4
DIOR
2
1
ATA_ISOLATION
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PDF描述
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