- 您現(xiàn)在的位置：買賣IC網(wǎng) > PDF目錄359149 > MC908QY8 (飛思卡爾半導體(中國)有限公司) To provide the most up-to-date information, the revision of our documents PDF資料下載
參數(shù)資料
| 型號： | MC908QY8 |
| 廠商： | 飛思卡爾半導體(中國)有限公司 |
| 英文描述： | To provide the most up-to-date information, the revision of our documents |
| 中文描述： | 為了提供最先進的最新資料，我們的文件修改 |
| 文件頁數(shù)： | 48/236頁 |
| 文件大?。?/td> | 1682K |
| 代理商： | MC908QY8 |
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Analog-to-Digital Converter (ADC10) Module
MC68HC908QB8 Data Sheet, Rev. 1
48
Freescale Semiconductor
3.8.2 ADC10 Result High Register (ADRH)
This register holds the MSBs of the result and is updated each time a conversion completes. All other bits
read as 0s. Reading ADRH prevents the ADC10 from transferring subsequent conversion results into the
result registers until ADRL is read. If ADRL is not read until the after next conversion is completed, then
the intermediate conversion result will be lost. In 8-bit mode, this register contains no interlocking with
ADRL.
3.8.3 ADC10 Result Low Register (ADRL)
This register holds the LSBs of the result. This register is updated each time a conversion completes.
Reading ADRH prevents the ADC10 from transferring subsequent conversion results into the result
registers until ADRL is read. If ADRL is not read until the after next conversion is completed, then the
intermediate conversion result will be lost. In 8-bit mode, there is no interlocking with ADRH.
Bit 7
6
5
4
3
2
1
Bit 0
Read:
0
0
0
0
0
0
0
0
Write:
Reset:
0
0
0
0
0
0
0
0
= Unimplemented
Figure 3-4. ADC10 Data Register High (ADRH), 8-Bit Mode
Bit 7
6
5
4
3
2
1
Bit 0
Read:
0
0
0
0
0
0
AD9
AD8
Write:
Reset:
0
0
0
0
0
0
0
0
= Unimplemented
Figure 3-5. ADC10 Data Register High (ADRH), 10-Bit Mode
Bit 7
6
5
4
3
2
1
Bit 0
Read:
AD7
AD6
AD5
AD4
AD3
AD2
AD1
AD0
Write:
Reset:
0
0
0
0
0
0
0
0
= Unimplemented
Figure 3-6. ADC10 Data Register Low (ADRL)
相關PDF資料 |
PDF描述 |
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