參數(shù)資料
型號： MC705L16CFUE
廠商： Freescale Semiconductor
文件頁數(shù)： 146/146頁
文件大小： 0K
描述： IC MCU 8BIT EPROM 80-QFP
標(biāo)準(zhǔn)包裝： 84
系列： HC05
核心處理器： HC05
芯體尺寸： 8-位
速度： 2.1MHz
連通性： SPI
外圍設(shè)備： LCD，POR，WDT
輸入/輸出數(shù)： 16
程序存儲器容量： 16KB（16K x 8）
程序存儲器類型： OTP
RAM 容量： 512 x 8
電壓 - 電源 (Vcc/Vdd)： 3 V ~ 5.5 V
振蕩器型： 內(nèi)部
工作溫度： -40°C ~ 85°C
封裝/外殼： 80-QFP
包裝： 托盤
Backplane Driver and Port Selection
MC68HC05L16 MC68HC705L16 Data Sheet, Rev. 4.1
Freescale Semiconductor
99
10.3 Backplane Driver and Port Selection
The number of backplane (port D) pins depends on the LCD duty. It is automatically selected by DUTY1
and DUTY0 bits in the LCD control register (LCDCR). On reset, these bits are cleared and 1/4 duty is
selected. (See Table 10-1.)
10.4 Frontplane Driver and Port Selection
The number of frontplane (FP) pins depends on the number of port D and port E bits. If port bits are
selected as a parallel output port, the number of the FP pins is decreased to 27 as a minimum. The
selections between frontplane and port (nibble wide) are done by the PEH, PEL, and PDH bits in the
LCDCR (see Table 10-2). These bits also can be controlled on a bit-wide basis by using the PDMUX and
PEMUX registers. PDH, PEH, and PEL have priority over the mux registers. On reset, port D and port E
bits are disconnected and FP27–FP38 pins output VDD levels.
Table 10-1. Backplane and Port Selection
Duty
LCD Control
Pin Selection
DUTY1
DUTY0
BP3/PD3
BP2/PD2
BP1/PD1
BP0
1 / 10
1PD3
PD2
PD1
BP0
1 / 2
1
0
PD3
PD2
BP1
BP0
1 / 3
1
PD3
BP2
BP1
BP0
1 / 4
0
BP3
BP2
BP1
BP0
Table 10-2. Frontplane and Port Selection
FP / Port Control
Port Selection
PEH
PEL
PDH
PDMx
PEMx
FP27:FP30/
PE7:PE4
FP31:FP34/
PE3:PE0
FP35:FP38/
PD7:PD4
00
FP35:FP38
01
Varied
1
X
PD7:PD4
00
FP31:FP34
01
Varied
1
X
PE3:PE0
00
FP27:FP30
01
1
Varied
1
X
PE7:PE4
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PDF描述
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